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   芯片、集成電路設(shè)計系列培訓(xùn)課程表

        培訓(xùn)結(jié)束后頒發(fā)工程師培訓(xùn)證書。
   班級規(guī)模及環(huán)境--熱線:4008699035 手機:15921673576( 微信同號)

        為了保證培訓(xùn)效果，增加互動環(huán)節(jié)，我們堅持小班授課，每期報名人數(shù)限3到5人。人手一機，全程實踐。
   上課時間和地點

          上課地點：【上海】：同濟大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山學(xué)院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
        　　本課程每期班限額5名，報滿即停止報名，請?zhí)崆霸诰�或電話預(yù)約
   課時
        ◆課時：咨詢在線客服
        ◆團體報名優(yōu)惠措施：兩人95折優(yōu)惠，三人或三人以上9折優(yōu)惠 。注意：在讀學(xué)生憑學(xué)生證，即使一個人也優(yōu)惠500元。
        
        ☆注重質(zhì)量
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        ☆合格學(xué)員免費推薦工作

        ☆合格學(xué)員免費頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)

        專注高端培訓(xùn)15年，端海提供的證書得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力
        得到大家的認(rèn)同，受到用人單位的廣泛贊譽。

        ★實驗設(shè)備請點擊這兒查看★
   質(zhì)量保障

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在下期培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費提供課后技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。
   課程大綱
        全部授課內(nèi)容均在計算機和實驗器材上實際操作。 有周末班、連續(xù)班、晚班任選

芯片、集成電路設(shè)計系列培訓(xùn)課程表
 

序號

課 程 名 稱

培 訓(xùn) 目 標(biāo)

最近開課時間

學(xué) 期

芯片、集成電路設(shè)計系列培訓(xùn)班

C1

基于ARM9的SoC芯片設(shè)計培訓(xùn)班

ARM9的SoC芯片設(shè)計流程及設(shè)計經(jīng)驗傳授,幫助你快速開展ARM9的芯片設(shè)計

2020年3月16日

5天；
30學(xué)時

C2

Altera ASIC 原型設(shè)計與HardCopy結(jié)構(gòu)化ASIC培訓(xùn)班

通過學(xué)習(xí)掌握Altera ASIC 原型設(shè)計與HardCopy結(jié)構(gòu)化ASIC

2020年3月16日

5天；
30學(xué)時

C3

數(shù)字電視及工業(yè)影像芯片

數(shù)字電視及工業(yè)影像芯片設(shè)計技術(shù)

2020年3月16日

5天；
30學(xué)時

C4

數(shù)�；旌想娐吩O(shè)計培訓(xùn)班

數(shù)�；旌想娐返脑O(shè)計與測試方法、技巧

2020年3月16日

5天；
30學(xué)時

C5

混合信號測試技術(shù)培訓(xùn)班

講解與混合信號有關(guān)的設(shè)計知識，采樣理論和如何正確采樣模擬信號的原則，如何從設(shè)計理念到測試設(shè)備來創(chuàng)造一個模擬信號，最后介紹如何從采樣數(shù)據(jù)中選用正確的測試方法并與芯片參數(shù)規(guī)范相聯(lián)系的方法。

2020年3月16日

5天；
30學(xué)時

C6

數(shù)字信號測試技術(shù)培訓(xùn)班

這個課程利用大量數(shù)字器件測試經(jīng)驗來解釋測試的概念和技術(shù)。課程提供了先進的半導(dǎo)體測試知識的概述，以及測試程序、現(xiàn)場調(diào)試技術(shù)和故障分析等。
詳細(xì)的討論DC、AC和功能性測試的知識。

2020年3月16日

5天；
30學(xué)時

C7

非揮發(fā)性內(nèi)存(NVM)硅智財(IP)的產(chǎn)品應(yīng)用培訓(xùn)班

主要內(nèi)容：電源管理PMIC，語音/家電微控制器MCU，觸控面板Touch panel controller and 機上盒。

2020年3月16日

5天；
30學(xué)時

C8

Design of ASIP DSP（ASIP DSP 設(shè)計）培訓(xùn)班

ASIP設(shè)計方法;有限長數(shù)字信號處理;DSP處理器結(jié)構(gòu)與微結(jié)構(gòu);指令集設(shè)計;編程工具設(shè)計;處理器數(shù)據(jù)通道；存儲器子系統(tǒng)；處理器控制通道;嵌入系統(tǒng)軟件設(shè)計(Application specific instruction set DSP processors)

2020年3月16日

5天；
30學(xué)時

C9

SystemC和系統(tǒng)級設(shè)計方法培訓(xùn)班

SystemC和系統(tǒng)級設(shè)計方法培訓(xùn)

2020年3月16日

5天；
30學(xué)時
C10
 DFT設(shè)計流程與Syntest DFT解決方案培訓(xùn) DFT設(shè)計流程與Syntest DFT解決方案
2020年3月16日
 5天；
30學(xué)時
C11
 CPU和SoC設(shè)計和驗證技術(shù)培訓(xùn)班 CPU和SoC設(shè)計和驗證技術(shù)傳授
2020年3月16日
 5天；
30學(xué)時
C12
 時序及噪音分析培訓(xùn)班 時序及噪音分析
2020年3月16日
 5天；
30學(xué)時
C13
 Timing-Driven Verilog Synthesis
for High-Performance System-on-Chip Design		 Timing-Driven Verilog Synthesis
for High-Performance System-on-Chip Design
2020年3月16日
 5天；
30學(xué)時
C14
 數(shù)字ASIC設(shè)計培訓(xùn)班 verification平臺建立/功能測試;設(shè)計綜合（synthesys）與掃描鏈測試(DFT);靜態(tài)時序分（STA）
2020年3月16日
 5天；
30學(xué)時
C15
 Flash Memory Testing培訓(xùn)班 NAND Flash 的基本測試方法;NOR Flash 的基本測試方法;常見Flash 測試系統(tǒng)的基本結(jié)構(gòu);Advantest的flash測試系統(tǒng)
2020年3月16日
 5天；
30學(xué)時
C16
 Be One Lab Functional Verification Methodology and Flow培訓(xùn)班 Be One Lab Functional Verification Methodology and Flow培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C17
 SoC芯片設(shè)計解決方案培訓(xùn)班 SoC芯片設(shè)計解決方案培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C18
 可擴展數(shù)字信號處理器結(jié)構(gòu)培訓(xùn)班 可擴展數(shù)字信號處理器結(jié)構(gòu)培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C19
 應(yīng)用SOC及低功耗技術(shù)的無線IC設(shè)計培訓(xùn)班
    SOC的設(shè)計方法與實現(xiàn)
    低功耗電路的特殊設(shè)計
    各種運算電路、濾波電路的設(shè)計考量
    調(diào)制解調(diào)電路的算法與設(shè)計
    傅利葉變換電路的設(shè)計技巧
2020年3月16日
5天；
30學(xué)時
C20
 IC Physical Design 介紹基于0.25um及以下工藝的數(shù)字IC設(shè)計流程和實現(xiàn)流程以及ASIC設(shè)計物理版圖方面設(shè)計的技巧和方法
2020年3月16日
 5天；
30學(xué)時
C21
 模擬集成電路設(shè)計(Analog IC Design) 電路設(shè)計模型及設(shè)計技巧
復(fù)雜電路的特殊處理
高頻模擬電路的特殊設(shè)計
2020年3月16日
 5天；
30學(xué)時
C22
 硬件仿真及仿真加速技術(shù)在超大規(guī)模集成電路設(shè)計中的應(yīng)用 硬件仿真及仿真加速技術(shù)在超大規(guī)模集成電路設(shè)計中的應(yīng)用
2020年3月16日
 5天；
30學(xué)時
C23
 基于SiGe BiCMOS 技術(shù)的射頻/混頻集成電路設(shè)計、制造及應(yīng)用 基于SiGe BiCMOS 技術(shù)的射頻/混頻
集成電路設(shè)計、制造及應(yīng)用
2020年3月16日
 5天；
30學(xué)時
C24
 32位RISC微處理器C*Core及其SOC設(shè)計培訓(xùn) 32位RISC微處理器C*Core及其SOC設(shè)計培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C25
 IC設(shè)計驗證的整體解決方案 IC設(shè)計驗證的整體解決方案
2020年3月16日
 5天；
30學(xué)時
C26
 SOC芯片設(shè)計系列培訓(xùn)之DFT & Digital IC Testing SOC芯片設(shè)計系列培訓(xùn)之DFT & Digital IC Testing
2020年3月16日
 5天；
30學(xué)時
C27
 Runtime IC設(shè)計流程與資源管理解決方案 Runtime IC設(shè)計流程與資源管理解決方案
2020年3月16日
 5天；
30學(xué)時
C28
 Synopsys物理綜合設(shè)計方法學(xué)和設(shè)計工具培訓(xùn)班 一、基于物理綜合的芯片實現(xiàn)方案介紹
二、新版物理綜合工具Physical Compiler介紹與使用技巧
三、基于Physical Compiler的設(shè)計流程演示
2020年3月16日
 5天；
30學(xué)時
C29
 集成信息和通訊系統(tǒng)的設(shè)計技術(shù)研究及其應(yīng)用培訓(xùn)班 集成信息和通訊系統(tǒng)的設(shè)計技術(shù)研究及其應(yīng)用培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C30
 Galaxy設(shè)計平臺高級培訓(xùn)班 Galaxy設(shè)計平臺高級培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C31
 Magma NanoTech Symposium培訓(xùn)班 Magma NanoTech Symposium培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C32
 智能傳感器SOC設(shè)計培訓(xùn)班 智能傳感器SOC設(shè)計培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C33
 0-in ABV ASIC驗證方法學(xué)培訓(xùn)班 0-in ABV ASIC驗證方法學(xué)培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C34
 大型RISC處理器設(shè)計培訓(xùn)班 大型RISC處理器設(shè)計培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C35
 ADC/DAC培訓(xùn)班 本課程講授數(shù)據(jù)轉(zhuǎn)換器的特性、結(jié)構(gòu)、組成單元、設(shè)計要點、校準(zhǔn)技術(shù)、低功耗設(shè)計技術(shù)以及設(shè)計實例等內(nèi)容，通過本課程的學(xué)習(xí)，可以基本掌握數(shù)據(jù)轉(zhuǎn)換器的設(shè)計原理、設(shè)計方法、關(guān)鍵電路設(shè)計點等，提高數(shù)據(jù)轉(zhuǎn)換器設(shè)計的一次成功率。
2020年3月16日
 5天；
30學(xué)時
C36
 RTL code與SOC關(guān)鍵技術(shù)培訓(xùn)班
“RTL code與SOC關(guān)鍵技術(shù)”課程為數(shù)字集成電路前端設(shè)計的專題進階類課程，內(nèi)容包含SOC設(shè)計、RTL代碼風(fēng)格、RTL code與VLSI體系架構(gòu)、專題針對性LAB等內(nèi)容；并在此基礎(chǔ)上講授提高設(shè)計效率、電路調(diào)試技巧以及電路優(yōu)化等高級話題。幫助學(xué)員掌握基于SYNOPSY EDA TOOLS構(gòu)成的完整ASIC設(shè)計流程。通過本課程的學(xué)習(xí)，學(xué)員能夠熟悉典型數(shù)字SOC設(shè)計，RTL代碼風(fēng)格編寫，并具備中級以上的數(shù)字電路設(shè)計水平。
2020年3月16日
 5天；
30學(xué)時
C37
 數(shù)字集成電路前端多時鐘設(shè)計專題班 本次課程講授PLL原理，結(jié)構(gòu)，應(yīng)用，各功能模塊以及頂層具體實現(xiàn)方案。通過本課程培訓(xùn)，學(xué)員可以掌握PLL的設(shè)計流程，并且能夠按照設(shè)計指標(biāo)要求，實現(xiàn)PLL的設(shè)計與仿真，掌握PLL中關(guān)鍵模塊的設(shè)計方法以及提高性能的具體方案。
2020年3月16日
 5天；
30學(xué)時
C38
 PLL設(shè)計實戰(zhàn)提高班 本次課程講授PLL原理，結(jié)構(gòu)，應(yīng)用，各功能模塊以及頂層具體實現(xiàn)方案。通過本課程培訓(xùn)，學(xué)員可以掌握PLL的設(shè)計流程，并且能夠按照設(shè)計指標(biāo)要求，實現(xiàn)PLL的設(shè)計與仿真，掌握PLL中關(guān)鍵模塊的設(shè)計方法以及提高性能的具體方案。
2020年3月16日
 5天；
30學(xué)時
C39
 模擬高級培訓(xùn)班 模擬高級培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
數(shù)字設(shè)計初、中級培訓(xùn)班 數(shù)字設(shè)計初、中級培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C40
 數(shù)字設(shè)計高級培訓(xùn)班

本課程將向?qū)W生提供集成電路設(shè)計的理論與實例相結(jié)合的培養(yǎng)訓(xùn)練，講述包括電路設(shè)計與仿真、版圖設(shè)計和驗證以及寄生參數(shù)提取的完整全定制集成電路設(shè)計流程以及CADENCE與IC制造廠商的工藝庫配合等內(nèi)容。通過系統(tǒng)的理論學(xué)習(xí)與上機實踐，學(xué)生可掌握集成電路設(shè)計流程以及各階段所使用的工具，并能進行集成電路的設(shè)計工作。

2020年3月16日
 5天；
30學(xué)時
C41
 數(shù)字IC前端設(shè)計高級培訓(xùn)班 本課程講授基于Synopsys EDA tools構(gòu)成的ASIC/SOC數(shù)字電路前端開發(fā)流程，授課內(nèi)容包括電路開發(fā)前期的系統(tǒng)定義、功能劃分、RTL代碼編寫技巧、驗證平臺TestBench編寫技巧、電路仿真技巧、ASIC綜合技術(shù)、ASIC靜態(tài)時序分析技術(shù)、DFT設(shè)計等。學(xué)員通過運用數(shù)字邏輯、硬件描述語言完成一個中等規(guī)模的專題項目設(shè)計，在課程過程中掌握數(shù)字集成電路的coding、仿真、綜合、靜態(tài)時序分析、可測性設(shè)計、一致性驗證等一系列數(shù)字電路前端流程中的設(shè)計技巧，最終使學(xué)員達到能獨立完成中等規(guī)模電路模塊的前端設(shè)計水平。
2020年3月16日
 5天；
30學(xué)時
C42
 Synopsys 軟件培訓(xùn)班（上） 本課程可幫助IC工程師進一步全面系統(tǒng)地理解IC設(shè)計概念與方法。培訓(xùn)將采用Synopsys公司相關(guān)領(lǐng)域的培訓(xùn)教材，培訓(xùn)方式以講課和實驗穿插進行。Synopsys Formality;Synopsys Prime Time 1；Synopsys Prime Time 2；TetraMAX 1；TetraMAX 2: DSMTest ATPG
2020年3月16日
 5天；
30學(xué)時
C43
 Synopsys 軟件培訓(xùn)班（下） DFT Compiler 1;HSPICE Essentials;HSPICE Advanced Topics;Design Compiler 1;Lynx Design System;Specman Elite Basics for Verification Environment Users
2020年3月16日
 5天；
30學(xué)時
C44
 集成電路版圖設(shè)計師中、高級培訓(xùn)班 集成電路工藝制造;集成電路設(shè)計EDA軟件;芯片物理結(jié)構(gòu)分析;版圖編輯;邏輯分析;物理驗證;芯片物理結(jié)構(gòu)分析;版圖編輯
2020年3月16日
 5天；
30學(xué)時
C45
 CPU源代碼分析與芯片設(shè)計及Linux移植 全面系統(tǒng)地講解了CPU的芯片設(shè)計技術(shù)。書中詳細(xì)分析了開放源代碼32位RISC CPU（or1200）的源代碼、編譯器的移植、Linux操作系統(tǒng)的移植，介紹了CPU源代碼在FPGA上的實現(xiàn)方法，說明了CPU芯片的全定制設(shè)計方法。
2020年3月16日
 5天；
30學(xué)時
C46
 聚焦離子束（FIB）技術(shù)在芯片設(shè)計及加工過程中的應(yīng)用 聚焦離子束（FIB）技術(shù)在芯片設(shè)計及加工過程中的應(yīng)用
2020年3月16日
 5天；
30學(xué)時
C47
 SpringSof/tLaker模擬與混合信號版圖設(shè)計培訓(xùn) SpringSof/tLaker模擬與混合信號版圖設(shè)計培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C48
 先進IC設(shè)計技術(shù)培訓(xùn)班 先進IC設(shè)計技術(shù)培訓(xùn)
2020年3月16日
 5天；
30學(xué)時
C49
 Cadence納米集成電路設(shè)計新技術(shù)培訓(xùn)班 Cadence納米集成電路設(shè)計新技術(shù)培訓(xùn)班
2020年3月16日
 5天；
30學(xué)時
C50
 集成電路設(shè)計驗證與失效分析案例 集成電路設(shè)計驗證與失效分析案例
2020年3月16日
 5天；
30學(xué)時
C51
 IC版圖設(shè)計中EDA工具定制應(yīng)用 IC版圖設(shè)計中EDA工具定制應(yīng)用
2020年3月16日
 5天；
30學(xué)時
C52
 IC 測試培訓(xùn)班 IC 測試培訓(xùn)
2020年3月16日
 5天；
30學(xué)時

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