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曙海教育集團(tuán)
上海:021-51875830 北京:010-51292078
西安:029-86699670 南京:4008699035
成都:4008699035 武漢:027-50767718
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嵌入式OS--4G手機(jī)操作系統(tǒng)
嵌入式硬件設(shè)計(jì)
Altium Designer Layout高速硬件設(shè)計(jì)
開發(fā)語言/數(shù)據(jù)庫/軟硬件測試
芯片設(shè)計(jì)/大規(guī)模集成電路VLSI
其他類
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  Cadence Incisive設(shè)計(jì)驗(yàn)證平臺培訓(xùn)
   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識:
        ◆ 電路系統(tǒng)的基本概念。

   班級規(guī)模及環(huán)境--熱線:4008699035 手機(jī):15921673576( 微信同號)
       每期人數(shù)限3到5人。
   上課時(shí)間和地點(diǎn)
上課地點(diǎn):【上海】:同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山學(xué)院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(中和大道) 【沈陽分部】:沈陽理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
最近開課時(shí)間(周末班/連續(xù)班/晚班)
Cadence Incisive設(shè)計(jì)驗(yàn)證平臺培訓(xùn):2020年3月16日
   實(shí)驗(yàn)設(shè)備
     ☆資深工程師授課

        
        ☆注重質(zhì)量
        ☆邊講邊練

        ☆合格學(xué)員免費(fèi)推薦工作

        ☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書,提升您的職業(yè)資質(zhì)

        專注高端培訓(xùn)15年,端海提供的證書得到本行業(yè)的廣泛認(rèn)可,學(xué)員的能力
        得到大家的認(rèn)同,受到用人單位的廣泛贊譽(yù)。

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   最新優(yōu)惠
       ◆請咨詢客服。
   質(zhì)量保障

        1、培訓(xùn)過程中,如有部分內(nèi)容理解不透或消化不好,可免費(fèi)在以后培訓(xùn)班中重聽;
        2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費(fèi)提供課后技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會。

  Cadence Incisive設(shè)計(jì)驗(yàn)證平臺培訓(xùn)
培訓(xùn)方式以講課和實(shí)驗(yàn)穿插進(jìn)行

課程描述:

?

課程介紹:

????此課程展現(xiàn)了Incisive設(shè)計(jì)和驗(yàn)證平臺的從行為級,RTL級到門級的完整的設(shè)計(jì)驗(yàn)證流程,本課程主要是針對具有集成電路設(shè)計(jì)和驗(yàn)證基本知識的設(shè)計(jì)或驗(yàn)證工程師而準(zhǔn)備。通過本課程的培訓(xùn)使用戶對Cadence的驗(yàn)證方法和工具使用有一個全面、整體概念,用戶在實(shí)際工作中能根據(jù)所掌握的概念和方法,應(yīng)用先進(jìn)的驗(yàn)證方法提高集成電路的驗(yàn)證效率和質(zhì)量。

?

Incisive??設(shè)計(jì)驗(yàn)證平臺介紹:

????要獲得今天的復(fù)雜集成電路功能驗(yàn)證所需的速度和效率要求我們采用一體化的驗(yàn)證方法。Cadence Incisive平臺適用于從系統(tǒng)設(shè)計(jì)到系統(tǒng)內(nèi)設(shè)計(jì)的所有設(shè)計(jì)驗(yàn)證領(lǐng)域 – 嵌入式軟件、控制、數(shù)據(jù)通路、模擬/數(shù)字混合信號。

Incisive平臺是世界上首個單內(nèi)核驗(yàn)證平臺,Incisive單內(nèi)核架構(gòu)支持Verilog, VHDL, SystemVerilog, SystemC, SCV(SystemC Verification), PSL/Sugar,算法開發(fā)和模擬/數(shù)字混合信號驗(yàn)證。它采用了通用的用戶界面和調(diào)試環(huán)境,支持全事務(wù)級的驗(yàn)證,一體化測試方法,按需加速。Incisive平臺提供業(yè)界最快速,最高效的驗(yàn)證方法。

?

課程目標(biāo):

After completing this course, you should be able to:

■?Briefly describe Incisive simulation

■?Set up your environment for Incisive simulation

■?Compile, elaborate, and simulate your design and testbench

■?Debug your design with the textual and graphical interfaces

■?Incorporate components of “foreign” languages in your simulation

■?Annotate SDF timing data to the HDL portions of your design

■?Incorporate C and C++ applications into your simulation

??

課程安排:

Unit 1

Time Topic

09:30-09:45??Introduction & agenda

09:45-10:00??Incisive simulation overview

10:00-10:30??Setting up the simulation environment

10:30-12:00??Compiling your design

12:00-13:30??LUNCH

13:30-02:15??Elaborating your design

02:15-03:45??Simulating your design

03:45-05:00??Debugging with the textual interface

?

Unit 2

Time Topic

09:30-10:00??Debugging with the textual interface

10:00-11:15??Debugging with the graphical interface

11:15-12:45??Simulating mixed-language designs

12:45-01:45??LUNCH

01:45-02:00??Introducing simulator utilities

02:00-03:30??[optional] Annotating SDF timing

03:30-05:00??[optional] Linking user applications

 

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