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FPGA設(shè)計系統(tǒng)應(yīng)用工程師培訓(xùn)

 
   班級規(guī)模及環(huán)境--熱線:4008699035 手機:15921673576( 微信同號)
       每期人數(shù)限3到5人。
   上課時間和地點
上課地點:【上?!浚和瑵髮W(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山學(xué)院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(中和大道) 【沈陽分部】:沈陽理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
最近開課時間(周末班/連續(xù)班/晚班):2019年1月26日
   實驗設(shè)備
     ☆資深工程師授課
        
        ☆注重質(zhì)量 ☆邊講邊練

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   質(zhì)量保障

        1、培訓(xùn)過程中,如有部分內(nèi)容理解不透或消化不好,可免費在以后培訓(xùn)班中重聽;
        2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費提供課后技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。

課程大綱
 

模塊一 基于FPGA的通信接口設(shè)計及外圍接口設(shè)計
FPGA設(shè)計應(yīng)用最為廣泛的領(lǐng)域之一為接口互聯(lián),基于FPGA的通信接口設(shè)計及外圍接口設(shè)計課程主要讓學(xué)員掌握外設(shè)通信接口的設(shè)計方法:在教員演示下完成一種通信接口的設(shè)計;
在教員指導(dǎo)下,獨立完成其它通信接口設(shè)計,包括協(xié)議分析、完成設(shè)計文檔、RTL設(shè)計、FPGA芯片選型等流程。(USB2.0,PCI,PCI-e,以太網(wǎng))
模塊二 基于FPGA的圖像視頻處理
FPGA設(shè)計應(yīng)用最為廣泛的領(lǐng)域之一為圖像與視頻處理,基于FPGA的圖像視頻處理內(nèi)容有:圖像和視頻處理基礎(chǔ)知識,使學(xué)員能夠?qū)崿F(xiàn)色彩空間變換、VGA控制器、JPEG 編碼基礎(chǔ)、2D-DCT變換、視頻處理體系及圖像FIR濾波器設(shè)計與實現(xiàn);視頻降噪算法設(shè)計與實現(xiàn),基于FPGA的常用視頻處理算法體系結(jié)構(gòu)、邊緣檢測算法等。
模塊三 SOPC設(shè)計流程
SoPC系統(tǒng)設(shè)計與應(yīng)用課程使學(xué)員熟練掌握參數(shù)化庫LPM模塊的使用; 精通FPGA中鎖相環(huán)模塊及SignalTap的使用;精通SoPCBuilder的使用,能夠用NiosII軟件集成開發(fā)環(huán)境IDE建立用戶程序; 掌握在NiosII系統(tǒng)中融入自己所設(shè)計IP的技術(shù)。
模塊四 SDRAM和DDR2/DDR3課程
SDRAM的發(fā)展歷史,L-Bank結(jié)構(gòu),SDRAM控制器的本地邏輯接口,SDRAM的工作原理,使用FPGA控制SDRAM的算法機模型(控制和數(shù)據(jù)通道的分離),以及SDRAM的邏輯控制:預(yù)充電,刷新,命令,突發(fā),寄存器設(shè)置,上電初始化,讀/寫序列等。
采用美光的器件模型,構(gòu)成完整的訪問控制模塊的編碼和驗證。該課程的目標是:通過學(xué)習(xí),學(xué)員將能夠獨立的編寫SDRAM和DDR2/DDR3控制器(含DIMM);
能夠理解和使用FPGA中關(guān)于DDR器件的專用電路;
能夠使用和分析FPGA廠家提供的相關(guān)IP;
能夠了解高速數(shù)據(jù)傳輸?shù)谋匾R(如隨路時鐘,復(fù)雜的跨時鐘域處理)。
模塊五 FPGA工程課程
該課程將講解和實踐FPGA從建模到PCB實現(xiàn)的工業(yè)過程。具體包括,從需求到FPGA的建模,IO端口電平標準,OCT,F(xiàn)PGA的專用電路,JTAG,如何設(shè)計FPGA的配置電路,高速信號的處理,SSN,SI和EMI,PCB的高速電路設(shè)計,BGA器件的扇出,文檔編寫。通過練習(xí),學(xué)員將完成一個完整的FPGA工程設(shè)計,包括硬件,固件和軟件和文檔部分。
硬件部分包括原理圖設(shè)計,多層電路板設(shè)計和高速電路設(shè)計;
固件部分包括HDL建模工程以及對應(yīng)的驗證工程;
軟件部分包括必要的上位機編碼;文檔部分包括產(chǎn)品使用說明書和產(chǎn)品設(shè)計報告和產(chǎn)品測試報告。該課程的目的:學(xué)員將能夠參與或完成FPGA工程;能夠提供規(guī)范的原理圖,能夠正確的進行PCB設(shè)計,能夠編寫完整的文檔,為企業(yè)提供具有完整實現(xiàn)能力和再實現(xiàn)能力的現(xiàn)代工程師。

 
  備案號:備案號:滬ICP備08026168號-1 .(2024年07月24日)...............